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燕山大学EDA课程设计.doc

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一设计要求
二、设计思路
三、设计过程
四、硬件调试
设计题目二
一.设计要求
二.设计思路
三.设计过程
四.硬件调试
EDA 课程设计报告
设计题目一 一设计要求 1、有十只 LED,L0……L9; 2、显示方式(初态为全亮); ①先奇数灯依次灭(灭的灯当下一个灯动作时,本灯回复原状态) ②再偶数灯依次灭(同上) ③再由 L0 到 L9 依次灭(同上) 3、显示间隔 0.5s、1s 可调。 二、设计思路 1.用两片 4-16 译码器 74154 分别控制奇数,偶数灯依次灭和 L0~L9 依次灭。 2.用 16 进制计数器 74161 连成 11 进制计数器,输出作为 74154 的输入和片选控制。 3.用三片 10 进制计数器 74160 连成 183 进制计数器,得到分频 电路。并用一个 T 触发器修改占空比为 1:2。 4.用一个 JK 触发器和一个控制端实现显示时间间隔可调。 三、设计过程 1.模块一 fenpin 电路图如下:
输入 732HZ 的 CP 信号,用三个 74160 连成 183 进制计数器再用一 个 T 触发器调节占空比为 1:2,得到 2HZ 的 CP1。 仿真图: 2.模块二 xuanpin 电路图如下:
| 用一个 JK 触发器实现二分频,控制端 M 为低电频时,输出 2HZ 的脉冲;控制端 M 为高电频时,输出 1HZ 的脉冲。 仿真图: 3.模块三 jisu 将 16 进制计数器连成 11 进制计数器,输出 QA、QB、QC、QD 作为模块 kongzhi 的输入,进位输出 CONTROL 作为模块 kongzhi 片 选端输入。 电路图如下
仿真图: 4.模块四 kongzhi 灯 L0,L1,L2,L3,L4,L5,L6,L7,L8,L9 依次与 10 个与 门连接。CONTROL 为 0 时第一片被选中,输入状态为 0000~1010, 输出 Y0~Y10 依次为 0,Y2~Y10 依次接与门 3,5,7,9,0,2,4, 6,8,YO 取非和 Y1 用一个或门连接与门 1,实现开始的全亮状态; CONTROL 为 1 时第二片被选中,输入循环 0000~1010,输出 Y0~Y10 依次连接与门 0,1,2,3,4,5,6,7,8,9。 此电路在控制端的作用下实现了奇数灯依次灭,偶数灯依次 灭, 。 电路图如下:
5.总电路图 huizong 仿真图 四、硬件调试 经下载,连线后,彩灯显示全亮状态,首次没有成功。检查发 现 CP 连线接触不良。经调试后,彩灯按要求依次亮。结果符合题目 要求,实验设计成功。
设计题目二 一.设计要求 1.有八只 LED,L0……L7 2.显示顺序如下表 3.显示间隔为 0.5S,1S 可调。 序号 L0 L1 L2 L3 L4 L5 L6 L7 0 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1 1 1 1 1 1 0 0 0 0 0 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1 1 1 1 0 1 0 0 0 0 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1 1 1 0 0 1 0 0 0 1 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1 1 0 0 0 1 0 0 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 1 0 0 0 0 1 0 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 1 0 0 0 0 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 1 0 0 0 0 0 0 0 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0
31 32 0 0 0 0 0 0 0 0 0 0 0 0 1 0 0 1 二.设计思路 1.用 74161 做 23 进制计数器进行分频分出 8Hz; 2.用数据选择器和十六进制加法计数器的分频功能做一个时间选 择器,控制时间间隔分别为 0.5s,1s 可调。 3.按彩灯的变化规律将整体变化情况分为四个部分,分别用移位 寄存器实现。 4.用两个 74161 做一个 33 进制计数器进行循环控制并用与、或、 非门在结合计数器和数据选择器做控制电路对四个显示模块按题目 要求进行选择控制,最终得出总的彩灯显示效果和时间可调要求。 三.设计过程 1.模块一 fenpin 电路图如下:
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