2009年江西理工大学微机原理与接口技术考研真题.doc

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2009 年江西理工大学微机原理与接口技术考研真题一、填空题（每空 1 分，共 35 分）二、选择题（每小题 2 分，共 20 分）下面每小题提供的 4 个答案中，只有一个是正确的。 1、在 8237A 控制下进行"存储器读传送"时，8237A 需先后向 I/O 接口和存储器发出的控制信号是①。

2、②是以 CPU 为核心，加上存储器、I/O 接口和系统总线组成的。 A、微处理器 B、微型计算机 C、微型计算机系统 D、微处理器系统 3、高速缓冲存储器（Cache）的存取速度_③。 A、比内存慢，比外存快 B、比内存慢，比内部寄存器快 C、比内存快，比内部寄存器慢 D、比内存快，比外存慢 4、80X86CPU 用于中断请求输入的引脚信号是④。 A、INTR 和 NMI B、INI 和 NMI C、INTR 和 INTA D、INTE 和 IRET 5、80X86 系列微处理器都有_⑤_三类寻址方式。 A、立即数寻址、寄存器寻址和存储器寻址 B、立即数寻址、基址寻址和变址寻址 C、立即数寻址、直接寻址和间接寻址 D、立即数寻址、基址寻址和存储器寻址 6、PC/386 以上的高档微机中，一般都有高速缓冲存储器，它是_⑥的缓存。 A、CPU 与视频设备之间 B、CPU 与硬盘之间 C、CPU 与主存储器之间 D、硬盘与主存储器之间 7、某异步串行发送器，发送具有 8 位数据位的字符，在系统中使用一个奇偶校验位和二个停止位。若每秒发送 100 个字符，则其波特率为_⑦位/秒。 A、1200 B、1100 C、1000 D、800 8、⑧是任何 I/O 接口中必不可少的逻辑部件。 A、数据缓冲器、控制寄存器、状态寄存器 B、数据缓冲器、端口地址译码器、读/写控制逻辑 C、数据缓冲器、端口地址译码器、中断控制逻辑 D、数据缓冲器、端口地址译码器、/O 缓冲器 9、可编程计数/定时器 8253 的工作方式共有__，，共有___个 I/O 地址。⑨ A、3 种，4 B、4 种，5 C、6 种，3 D、6 种，4 10、处理器定时工作的时间单元从大到小依次为⑩_。 A、时钟周期、指令周期、总线周期 B、指令周期、总线周期、时钟周期

C、总线周期、指令周期、时钟周期 D、总线周期、时钟周期、指令周期三、问答题（45 分） 1、向量中断与中断向量在概念上有什么区别?中断向量和中断向量地址又有什么区别?（9 分） 2、请写出中断程序的组成部分和每一部分完成的功能。（10 分） 3、请说明 I/O 接口的基本功能和基本结构。（10 分） 4、Cache 技术的基本思想和出发点是什么?一个 Cache 系统由哪几个主要部分组成?（10 分） 5、已知在指令执行前，有 DIl=0300H，BX=0010H，CF=0，DS=2000H，SS=3000H，BP=0100H， SP=0020H，【DS∶310H】=0AAH，【DS∶311H】=55H。（6 分）四、应用题（50 分） 1、设 8255A 芯片的端口地址为 300H~303H（端口 A 地址为 300H），要求 A 组与 B 组均工作在方式 0。其中∶端口 A 是输入口;端口 B 是输出口，端口 C 的高四位为输出口，低四位为输入口，编写初始化程序。（6 分）附∶8255A 控制字

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