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数字时钟24进制含555.74ls90电路图.docx

发布时间：2022-06-06 发布人：admin 分类：说明书 资料大小：0.23M 资料格式：docx 举报 版权申诉
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    数字电子技术课程设计报告 一、 课程设计目的： 1、 学会设计一般电路的基本思想 2、 了解电子器件的功能及作用 二、 主要器件： 74LS160（4 片），74LS00（2 片），74LS04（1 片），74LS48（4 片）， 七段共阴极数码管（4 只），555（1 片） 三、 器件引脚介绍： 1、74LS160（同步十进制加法计数器） 2、74LS00（2*4 输入与非门）
    3、74LS04（6 输入非门） 4、74LS48（数码管的驱动芯片） 5、七段共阴极数码管
    6、555 四、 思路的局部功能介绍： 1、 秒脉冲产生部分 采用 555 多谐振荡器产生 1HZ 频率信号，作为秒脉冲！整体电 路的信号输入部分。 2、 计数部分（下面时、分的计数电路） 74LS160 是同步预置数异步清零的十进制计数器
    160 的清零是异步的。当清除端 RD’为低电平时，不管时 钟端 CP 状态如何，即可实现清除功能。 160 的置数是同步的。当置入控制端 LD’为低电平时，在 CP 上升沿作用下，输出端 Q0-Q3 与数据输入端 A、B、C、D 一 致。 对于设计所需要的 12 进制和 60 进制，通过下图的计数器 和相应得门电路综合控制可以实现该要求。本实验采用的 60 进 制 是 利 用 74ls160 的 异 步 清 零 功 能 ， 而 12 进 制 利 用 了 74ls160 的同步置数功能。在 12 进制中，因为要实现达到 12 即跳到 1 的功能，因此在计数器达到 12 时，在下一个脉冲到 来时给两个计数器 74ls160 置数 01。60 进制中，因为采用的 是清零法，所以采用了锁存器。这是因为异步清零时的速度是 相当快的，导致计数不稳定。 3、 显示部分（下面是时、分的显示电路）
    译码器是一个多输入、多输出地组合逻辑电路。它的工作 是把给定的代码进行“翻译”，变成相应的状态，使输出通道 中相应的一路有信号输出。译码器在数字系统中有广泛的用途， 不仅用于代码转换、终端的数字显示，还用于数字的分配，存 储器的寻址和组合控制信号等。译码器可以分为通用译码器和 显示译码器两大类。在电路中采用的是共阴极译码器 7448，它 把 BCD 码译成七段数码管显示的 a-g，在由数码管显示相应的 数字。 4、 校时部分 校时电路通过开关对时、分的校正控制。开关 A 是控制分 的校正，开关 B 是控制时的校正。
    5、 整体电路显示 五、 问题及感想 在软件仿真时，出现过很多错误；不是显示仿真错误，就是没 显示。最后多加了解了 74LS160 以后，对电路图进行了修改出现 了，很满意的结果。 焊接电路板过程中，原本想按照仿真图可以随便的作出来，所 有连接好以后，发现数字显示有问题：每次秒显示从 8 先跳到 19
    然后到 10，同样 18 跳 29 到 20。后来在同学的帮助下，在秒个位 进位的连接中加上了一个反向器，使电路正常！在作校时电路时， 也偶到了很多问题，并都一一解决！ 通过这次课程设计，在设计中，必须认认真真的连接好每一个 线路，偶到问题必须仔细检查电路。焊接当中不能有半点马虎， 检查当中也不能有任何疑漏。 六、 参考文献 [1] 阎石 《数字电子技术基础（第五版）》 高等教育出版社 [2] 何凤庭 《电子技术基础实验教程》 湘潭大学出版社
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